高频开关电源驱动芯片单元 EMC 辐射测试摸底 依据 GB 9254 标准排查芯片振荡辐射干扰

供应商
深圳市南柯电子科技有限公司
认证
手机号
15012887506
经理
黄志浩
所在地
深圳市宝安区航城街道洲石路九围先歌科技园4栋105-1
更新时间
2026-02-16 07:00

详细介绍-

一、标准限值与测试方法

1. 核心限值要求

根据 GB/T 9254.1-2021信息技术设备在 30MHz-1GHz 频段的辐射发射限值分为两类:

  • A 级设备(工业环境):10 米法限值为 34dBμV/m(对应 3 米法 44dBμV/m)

  • B 级设备(家庭环境):10 米法限值为 40dBμV/m(对应 3 米法 50dBμV/m)

  • 测试需在屏蔽室或电波暗室中进行,使用双锥天线(30-200MHz)和对数周期天线(200MHz-1GHz),天线高度 1-4米,扫描步长≤1% 频率间隔中国网络安全审查认证和市场监管大数据中心。

    2. 干扰源定位方法
  • 近场扫描:使用高频磁场探头(如 100MHz-1GHz带宽)定位芯片表面的辐射热点,重点关注时钟引脚、电源轨及开关节点。

  • 频谱分析:通过 EMI 接收机记录超标频段,结合傅里叶变换(FFT)识别干扰源频率成分。例如,若在 150MHz处出现峰值,可能是开关频率的 5 次谐波(假设基频 30MHz)。

  • 信号注入:对芯片的 PWM 输出、时钟输入等关键信号注入正弦波,观察辐射响应变化,验证干扰路径。

  • 二、芯片级干扰源分析与抑制

    1. 内部振荡机制

    驱动芯片内部的 DC-DC 转换器、PWM 控制器等模块是主要辐射源:

  • 开关噪声:MOSFET 的 dv/dt(>50V/ns)和di/dt(>10A/ns)会激发宽频带电磁能量,其谐波可延伸至 GHz 级。

  • 时钟抖动:内部振荡器的相位噪声会导致频谱扩散,尤其在锁相环(PLL)失锁时加剧辐射。

  • 地弹干扰:芯片地平面的瞬间电位波动(ΔV=di/dt×Lgnd)会通过电源引脚耦合至外部电路。

  • 2. 硬件级抑制措施
  • RC 吸收电路:在续流二极管两端并联 2200pF 电容 + 10Ω 电阻,可将电压振铃从 150mV 降至 20mV以下。

  • 电源滤波优化:在 VCC 引脚并联 100nF 陶瓷电容(引线长度 < 3mm)+10μH 铁氧体磁珠,形成 LC低通滤波器,抑制高频噪声传导。

  • 扩频技术:若芯片支持(如 Maxim MAX9242),启用 ±2% 或 ±4%的扩频调制,将单一谐波峰值分散到更宽频段,降低局部辐射强度。

  • 三、PCB 设计与布局优化

    1. 高频布线规则
  • 阻抗控制:对时钟线、PWM 信号线采用 50Ω 微带线(线宽 0.8mm,FR-4 板材 Dk=4.2),避免 90°拐角(改用 45° 或圆弧过渡),过孔周围添加接地孔形成屏蔽。

  • 差分信号处理:差分时钟对采用等长布线(长度差≤3mm),间距保持为线宽的 1.5 倍,抑制共模辐射。

  • 走线缩短:将芯片到功率器件的驱动线长度控制在 10mm 以内,减少辐射天线效应。

  • 2. 电源与接地设计
  • 多层板结构:采用 6 层板(信号层 - 地层 - 电源层 - 信号层 - 地层 -信号层),为高频信号提供完整地平面参考,降低阻抗(<0.1Ω)。

  • 星型接地:功率地(PGND)与信号地(SGND)通过 0Ω 电阻单点连接,避免地环路。

  • 去耦电容布局:在芯片每个 VCC 引脚附近放置 0.1μF 陶瓷电容,形成 “电容矩阵”,覆盖 10MHz-1GHz频段的去耦需求。

  • 四、屏蔽与滤波技术

    1. 物理屏蔽方案
  • 金属屏蔽罩:采用 1mm 厚铝制屏蔽罩,接缝处使用导电泡棉(压缩率 30%)密封,屏蔽效能≥60dB。

  • 局部屏蔽:在芯片周围铺设接地铜箔,形成法拉第笼,通过密集过孔(间距≤2mm)连接至地层。

  • 吸收材料应用:在屏蔽罩内部粘贴 3M™ EMI 吸收材料(如 EM80KM,200MHz-4GHz损耗≥10dB),抑制腔体谐振。

  • 2. EMI 滤波器设计
  • 输入滤波:在电源线入口处安装 π 型滤波器(差模电感 10μH+X 电容 0.1μF + 共模电感 30mH+Y 电容2200pF),对 150kHz-30MHz 传导干扰衰减≥40dB。

  • 输出滤波:在驱动信号线上串联铁氧体磁珠(如 TDK BLM21PG121SN1,100MHz 阻抗120Ω),抑制高频谐波。

  • 五、整改验证与优化

    1. 测试验证流程
    1. 预测试:在开放场地(OATS)进行 3 米法辐射扫描,记录超标频段。

    2. 整改实施:按优先级依次应用吸收电路、屏蔽罩、滤波器等措施。

    3. 对比测试:每次整改后重复测试,确保辐射值降低≥6dB,且不引入新的干扰峰。

    4. 裕量评估:终测试结果需预留≥6dB 裕量,例如 A 级设备控制在 38dBμV/m 以下。

    2. 典型案例分析

    某 BUCK 电路在 150MHz 频段辐射值达 42dBμV/m(A 级标准 34dBμV/m),通过以下措施整改:

    1. 续流二极管优化:并联 2200pF+10Ω 吸收电路,该频段辐射降至 35dBμV/m。

    2. PCB 布局调整:将驱动线长度从 15mm 缩短至 8mm,并增加接地屏蔽环,辐射进一步降至 32dBμV/m。

    3. 屏蔽罩应用:添加铝制屏蔽罩后,终测试值为 28dBμV/m,满足 A 级标准且预留 6dB 裕量。

    六、工具与资源支持

  • 仿真工具:使用 ADS 或 HFSS 对芯片封装、PCB 布局进行电磁仿真,预测辐射热点。

  • 材料选型:3M™ 1135-CL 导电衬垫(高频接触电阻 < 0.05Ω)、TDK PC50铁氧体磁芯(高频损耗因子 tanδ<0.05)。

  • 标准文档:GB/T 9254.1-2021《信息技术设备 电磁兼容 第 1 部分:发射要求》、CISPR32:2015《信息技术设备 无线电骚扰特性 限值和测量方法》。


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