DDR3信号完整性测试，DDR3电源完整性测试，DDR3时序测试

测量方法

JEDEC规范定义了 DRAM的引脚或球必须满足的电气与定时方面的要求。一些较新的DDRDRAM采用了精细球栅阵列(FBGA)封装，此封装下的焊接球很难接触。因此，我们建议测量时，探头应尽可能接近DRAM的球状焊点。通常，我们可以在与焊接球相连的过孔上或与其相连的电阻靠近DRAM一侧的焊盘上测量。

目前的差分有源电压探头能在探头顶端容性负载低于0.22pF的情况下达到高达13GHz的测量带宽。此类工具对DDR信号(通常为单端信号)的影响非常小，很适合DDR测量，强烈建议大家使用。由于DDR信号对噪声非常敏感，因此建议在测量此类信号时采用带宽足够大的示波器，以避免示波器的噪声影响测量。有些示波器具备带宽压缩功能，能调节至恰好适合测量的带宽，以实现和可重复的测量。图1所示为13GHz差分有源探头连接到DDR2 DIMM的过孔上的情形。